| 1. verilog不是軟件包，是一種VLSI設計語言 |
| 送交者: wolfy 2013月11月13日07:42:12 於 [世界軍事論壇] 發送悄悄話 |
| 回 答: 無知啊！ 由 吹牛的馬甲 於 2013-11-13 03:11:16 |
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1. verilog不是軟件包，是一種VLSI設計語言。 2. 中國沒有做這些軟件包很大程度上不是因為做不出來。而是因為這些軟件包廠商為了占有市場，對中國盜版的情況不加追究。這樣中國自己本土企業沒有自己研發的動力。要是這些軟件包廠商對中國中國進行封鎖，沒看出來中國做這些軟件包有啥主要技術問題。沒用過autoCDA，至少VLSI設計軟件包是這樣。 |
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